Ibm HANDBOOK 260 Uživatelský manuál Strana 41

  • Stažení
  • Přidat do mých příruček
  • Tisk
  • Strana
    / 286
  • Tabulka s obsahem
  • KNIHY
  • Hodnocené. / 5. Na základě hodnocení zákazníků
Zobrazit stránku 40
Hardware Overview 23
In a high performance platform, with multiple processors and multiple
memories, a switch may be employed to allow multiple parallel accesses
by the processors to memory. The path through the switches would be
decided by the addressing of memory.
Figure 7. General Platform Topology
Primary Processor Bus/Switch
System Memory Host Bridge
Secondary Bus (PCI)
. . .
. . .
. . .
. . .
PowerPC Processor
(L1/L2 Cache)
PowerPC Processor
(L1/L2 Cache)
Tertiary Bus (ISA or PCI)
I/O Device I/O Device
. . .
I/O Device
I/O Device
Bus
Bridge
Zobrazit stránku 40
1 2 ... 36 37 38 39 40 41 42 43 44 45 46 ... 285 286

Komentáře k této Příručce

Žádné komentáře